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PCI-SIG宣布2021年推出PCIe 6.0標準 最高帶寬再升至256GB/s

摘要:2019度PCI-SIG開發(fā)者大會這2天正在美國加州圣克拉拉舉行,PCI-SIG今天又宣布了一個重大新聞:PCI Express? 6.0規(guī)范將計劃在2021年發(fā)布,下一代PCIe技術將使數(shù)據(jù)速率再次翻倍,達到64 GT/s,同時保持與上一代的向后兼容性,并提供能效和經(jīng)濟高效的性能。

  2019度PCI-SIG開發(fā)者大會這2天正在美國加州圣克拉拉舉行,PCI-SIG今天又宣布了一個重大新聞:PCI Express® 6.0規(guī)范將計劃在2021年發(fā)布,下一代PCIe技術將使數(shù)據(jù)速率再次翻倍,達到64 GT/s,同時保持與上一代的向后兼容性,并提供能效和經(jīng)濟高效的性能。

  就在短短3周前的5月29日,PCI-SIG剛正式發(fā)布PCIe 5.0基礎規(guī)范 v1.0版本,與上一個版本PCIe 4.0正式規(guī)范發(fā)布才相隔1年半時間,PCIe 5.0的原始比特傳輸速率定義為32 GT/s,比4.0翻了一倍。

  PCI-SIG總裁Al Yanes在新聞稿中表示,PCIe 6.0規(guī)范正處于一個快速發(fā)展的時間表,將繼續(xù)根據(jù)PCIe 5.0規(guī)范設定的趨勢,由于成員公司的持續(xù)承諾,我們正在加快步伐,在一個能夠滿足行業(yè)吞吐量需求的時間框架內,將帶寬再翻一番。

  PCIe 6.0 特點:

  提供64 GT/s原始比特率,x16配置實現(xiàn)高達256 GB/s帶寬

  引入PAM-4編碼并利用業(yè)內現(xiàn)有的56G PAM-4技術

  包括低延遲前向糾錯(FEC)和其他機制以提高帶寬效率

  與所有上一代PCIe技術保持后向兼容性

內容來自:電子測試測量之家
本文地址:http://odinmetals.com//Site/CN/News/2019/06/20/20190620033627027500.htm 轉載請保留文章出處
關鍵字: PCIe 6.0
文章標題:PCI-SIG宣布2021年推出PCIe 6.0標準 最高帶寬再升至256GB/s
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